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애플 5나노 칩이 2나노 기대를 흔든 이유

Tech Meets East · 2026-11-04 · 유튜브 시청 684 · 게시판 조회 0 · 외국인

응용파운드리·시스템

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난이도 응용#파운드리#GAA#공정#웨이퍼원가#칩설계

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저자: Tech Meets East (외국인) · 원제: Apple's 5nm Chip Just Made TSMC's 2nm Chips Look Like a JOKE!

난이도 판정: GAA 트랜지스터, 누설 전류, 웨이퍼 원가, 수율 같은 반도체 공정·산업 용어가 함께 나와 기초 이상의 배경지식이 필요합니다. 다만 공정 수치를 직접 계산하기보다 비유와 뉴스 수준의 해설이 많아 3단계로 판단했습니다.

요약

2나노 공정의 실제 가치는 노드 이름보다 설계에 달려 있다는 관점에서 출발합니다. 5나노 M1과 2026년 칩을 비교하고, GAA 구조로 누설 전류를 줄이는 원리, 수요와 리드타임, 웨이퍼 원가 상승을 차례로 짚습니다. 같은 공정에서도 전력과 발열 결과가 달라지는 이유를 설명합니다.

⏱ 00:001. 2나노 수익 구조와 공정 점유

⏱ 00:002026년 기준 최첨단 공정의 매출은 가장 새로운 노드가 아니라 한 세대 전 공정에서 더 많이 나온다는 점에서 출발합니다. 발표에 따르면 TSMC 웨이퍼 매출에서 5나노 계열이 약 33%를 차지하는 반면, 2나노는 약 3%에 그칩니다. 2나노 웨이퍼 한 장은 약 3만 달러로 알려져 있으며, 2025년 말 신주, 가오슝, 바오산 팹이 동시에 양산 체제에 들어갔다고 합니다.

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⏱ 00:342. GAA 나노시트 트랜지스터의 구조 변화

⏱ 00:342나노 팹은 여과된 공기의 낮은 소음과 천장 레일을 따라 움직이는 웨이퍼 포드가 특징이라고 소개합니다. 핵심 기술은 GAA(Gate-All-Around) 나노시트 트랜지스터입니다. 기존 구조는 게이트가 채널의 세 면만 잡았지만, GAA는 게이트가 채널을 사방에서 감싸 제어력을 높입니다.

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트랜지스터가 작아질수록 꺼져 있어야 할 때도 전류가 새는 문제가 커지는데, 이 누설 전류가 전력 낭비와 발열로 이어집니다. 구조 변화로 누설을 줄이고 제어를 정밀하게 만들 수 있다는 설명입니다. TSMC가 밝힌 목표치는 3나노 대비 동일 전력에서 성능 10~15% 향상, 동일 성능에서 전력 25~30% 절감, 집적도 약 15% 향상입니다.

⏱ 02:063. 수요 쏠림과 설계 비용

⏱ 02:062나노 관련 노드의 리드타임은 78주에서 156주로 늘어났고, 주문은 2028년까지 차 있는 것으로 알려져 있습니다. 단일 2나노 칩 플랫폼 설계 비용은 약 7억 2,500만 달러로 제시되며, 고객 설계 약 25건이 확정되고 70건 이상이 개발 중입니다.

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2026년 2분기 TSMC 매출은 전년 대비 36% 증가한 402억 달러였고, 고성능 컴퓨팅이 66%를 차지했습니다. 최첨단 수요가 스마트폰에서 AI 가속기와 서버 랙 쪽으로 옮겨가고 있다는 정리입니다.

⏱ 03:514. 노드 이름은 측정값인가 브랜드인가

⏱ 03:512020년 애플 M1은 TSMC 5나노 공정으로 만들어졌고, 팬 없이 동작하는 노트북으로 주목받았습니다. 발표자는 성공 요인으로 고성능 코어와 효율 코어를 나눈 구성, 메모리를 프로세서 가까이 두는 공유 구조, 그리고 자체 소프트웨어의 역할 분배를 꼽습니다.

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동시에 5나노 공정에서 가장 미세한 금속 배선 간격은 약 28~30나노미터 수준이라고 설명합니다. 과거에는 노드 이름이 실제 치수를 반영했지만 지금은 세대를 가리키는 브랜드 명에 가깝다는 주장입니다.

⏱ 06:515. 같은 노드, 다른 결과: 설계의 격차

⏱ 06:512026년 저가 노트북 맥북 네오는 3나노 A18 Pro 칩을 쓰지만, 리뷰에서는 2020년 5나노 M1과 비교되었습니다. 멀티 코어 성능은 M1 에어와 대등했고 싱글 코어에서는 앞섰습니다. 발표자는 이를 설계 역량의 결과로 봅니다.

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2025년 같은 TSMC 3나노 칩끼리 비교한 테스트도 인용합니다. 최대 부하에서 A19 Pro는 약 12와트, 스냅드래곤 8 엘리트 Gen 5는 약 19와트를 소비해 같은 작업에 약 60% 더 많은 전력이 들었습니다. 공정을 자동차, 설계를 운전자에 비유하며, 같은 벽돌을 받아도 무엇을 어떻게 쌓느냐가 결과를 가른다고 정리합니다.

⏱ 11:326. 웨이퍼 원가와 비용 구조

⏱ 11:32웨이퍼 가격은 2020년 5나노 약 1만 6천 달러, 2022년 3나노 약 1만 8천~2만 달러, 2나노 약 3만 달러로 추정되며, 다음 노드 A16급은 약 4만 5천 달러로 전망된다고 합니다. TSMC는 가격을 공개하지 않으므로 업계 추정치입니다. 분석가 댄 니스테트는 평균 웨이퍼 가격이 약 3,500달러에서 7,000달러 미만으로 거의 두 배가 되었다고 지적합니다.

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발표자는 트랜지스터당 비용이 10년 넘게 크게 떨어지지 않았다는 분석도 소개합니다. 칩 원가는 웨이퍼 가격을 양품 칩 수로 나눈 값이라 면적이 커질수록 부담이 커집니다. 2나노 팹 건설비는 월 5만 장 기준 약 280억 달러로 추산됩니다. 삼성 2나노는 웨이퍼당 비용이 낮을 것으로 추정되지만 수율이 약 55~60%로 보고되며, 일본 라피더스는 2027년 상용화와 웨이퍼당 약 2만 달러를 목표로 한다고 전합니다.

⏱ 14:027. 2나노 스마트폰 사례와 결론

⏱ 14:02삼성 엑시노스 2600은 세계 최초의 2나노 모바일 칩으로 소개되었지만, 갤럭시 S26 플러스 리뷰에서는 메뉴와 홈 화면을 넘기는 것만으로도 발열이 심했다고 전합니다. 이 칩은 TSMC가 아닌 삼성 2나노 공정이며, 파운드리마다 공정 기준이 다르다는 점도 짚습니다.

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반면 2026년 9월 공개된 애플 A20 Pro는 TSMC 2나노로 양산되었고, 초기 2나노 물량의 거의 절반을 애플이 선점했다고 합니다. 비교 테스트에서 퀄컴 칩은 멀티 코어에서 앞섰지만 풀 로드 시 20와트 이상을 쓰고 칩 면적도 약 21% 더 컸습니다. 발표자는 노드가 성능의 한계를 정하고, 그 한계에 얼마나 가까이 가는지는 설계가 결정한다고 맺습니다.

난이도 응용#파운드리#GAA#공정#웨이퍼원가#칩설계

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